La plataforma de simulación de señal mixta de Siemens acelera la verificación en circuitos integrados y se apoya en nuevas metodologías EDA
La nueva plataforma Symphony Pro de Siemens Digital Industries Software resuelve los retos de verificación de diseño de sistemas en chip (SoC) de señal mixta. Esta herramienta amplía las funciones de verificación de señal mixta e incluye a las nuevas metodologías de verificación estandarizadas de Accellera con una potente depuración visual, Siemens señala que se obtienen una mejora de la productividad de hasta 10 veces en comparación con las soluciones anteriores.
Las aplicaciones de siguiente generación automotrices, de imagenología, IoT, 5G, cómputo y almacenamiento traerán una fuerte demanda de mayor contenido analógico y de señal mixta en los SoC. Cada vez se encuentran más los circuitos de señal mixta en la integración de la cadena de señales analógicas, en el extremo frontal digital (DFE) en las radios 5G massive-MIMO, en los convertidores de datos digitales de muestreo de RF en los sistemas de radar, en los sensores de imagen que combinan circuitos de lectura de píxeles analógicos con el procesamiento de señales de imagen digital, o alimentando recursos computacionales de datacenters con un número cada vez mayor de datos utilizando circuitos avanzados de señal mixta para ofrecer señalización PAM4. Para estas y otras aplicaciones muy avanzadas, la herramienta EDA de circuitos de señal mixta permiten reducir la potencia, área y el costo, y ofrecen cifras de rendimiento cada vez mejores.
La creciente aplicación de técnicas de control digital, calibración y procesamiento de señales digitales en las arquitecturas de chips de señal mixta impulsan un cambio de paradigma en las metodologías de verificación de señal mixta con enfoques más centrados en lo digital. La nueva plataforma EDA Symphony Pro de Siemens, basada en las plataformas Symphony y Questa Visualizer de Siemens, permite la rápida implementación del estándar del sector Metodología de Verificación Universal (UVM) y el Formato Unificado de Potencia (UPF) como técnicas de baja potencia al ámbito de la señal mixta, ofreciendo un rápido rendimiento de simulación en una interface unificada para lograr un gran performance.
Los SoC de señal mixta integran circuitos analógicos con puertas lógicas que funcionan a velocidades de reloj muy altas. Este flujo de señales bidireccional de alta frecuencia en la frontera entre lo analógico y lo digital supera el límite de las metodologías de depuración manual, lo que repercute en el tiempo total de obtención de resultados. El entorno de la herramienta EDA Symphony Pro Visualizer MS ofrece una experiencia de depuración en toda la jerarquía de diseño de señal mixta con un análisis completo, automatización y facilidad de uso para aumentar la productividad.
"La verificación funcional de señal mixta es cada vez es más importante para nuestros diseños en los sectores de la imagen y automotriz. Hemos participado en el programa beta de Symphony Pro y observamos un aumento de la productividad gracias a las capacidades de depuración y compatibilidad con las configuraciones de sándwiches multicapa en Symphony Pro", señala Stéphane Vivien, director de CAD división de imagen de STMicroelectronics. "Utilizaremos Symphony Pro como nuestra solución para los proyectos de verificación de señal mixta que vengan".
"Nuestros chips de alto rendimiento y eficiencia energética diseñados para IoT son de naturaleza analógica intensiva y de señal mixta. Para garantizar una alta calidad, ampliamos nuestra metodología de verificación digital para permitir una regresión eficaz de nuestros diseños de señal mixta", dijo Jayanth Shreedhara, director senior de CAD en Silicon Labs. "La tecnología de señal mixta Symphony Pro Visualizer aceleró el tiempo de depuración de nuestras pruebas digitales sobre UVM, aumentando nuestra productividad de verificación de días a horas y mejorando drásticamente nuestro cierre de cobertura."
"Nuestros clientes avanzan en los diseños de SoC de señal mixta en diferentes aplicaciones, y en esta actividad, descubren nuevos requerimientos para las herramientas EDA necesarias sobre diseñar, verificar y validar estos chips", comenta Ravi Subramanian, VP de IC Verification en Siemens Digital Industries Software.
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